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A
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的Verilog方式:
reg [a-1:0] or_of_array;
integer i;
always @* begin
or_of_array = array[0];
for(i=1; i<b; i=i+1) begin
or_of_array = or_of_array | array[i];
end
end
SystemVerilog的方式:
logic [a-1:0] or_of_array;
always_comb begin
or_of_array = 0;
foreach(array[i]) begin
or_of_array |= array[i];
end
end
的SystemVerilog還支持wire [a-1:0] wire_or_of_array = array.or();
但並非所有合成器的支持。
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您可以直接使用循環到或每個元素與以前的元素。
wire [a-1:0] op;
// Inside an always block
for (int i = 0; i < array.size(); i++)
op = op | array[i];
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使用或減運算符:'a = | b;'。見[this](https://www.utdallas.edu/~akshay.sridharan/index_files/Page5212.htm) – callyalater
感謝您的諮詢。這是一個比較明智的OR,但是我想要做的是二維數組的元素OR。 – raymondxuym