dma

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    我想爲我的UART Rx和Tx使用DMA。到目前爲止,我有免費的RTOS版本的串行演示工作正常。它仍然正常工作。但是,現在我已經結合了示例項目中的UART DMA示例。 該代碼是有條件編譯的,因此,當交換機_HAS_DMA == 1時,只有配置了DMA引擎時,纔會配置ram緩衝區,並刪除FreeRTOS演示所需的默認UART ISR。 在這一點上,無論何時我發送一個串行字節流,正在運行的項目都會被

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    我寫一個驅動器,用於Altera Soc Developement Kit和需要支持的數據傳輸到/兩種模式從FPGA: FIFO傳輸:當寫入(或讀取)的FPGA FIFO,目的地(或源)地址不得由DMA控制器增加。 非FIFO傳輸:這些是正常的(類RAM)傳輸,其中源地址和目標地址都需要每個傳輸字的增量。 我使用的特定DMA控制器是CoreLink DMA-330 DMA控制器,其Linux驅動程

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    是否有可能通過altera在Qsys(quartus 14.0)中提供的IP核«Cyclone V Avalon-MM for PCIe»進行DMA轉移? Altera提供了一個名爲«Cyclone V Avalon-MM DMA for PCIe»的ip內核來執行dma transfert。但是這個ip-core不支持1x通道的PCIe Gen1。 「Cyclone V Avalon-MM fo

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    dma_alloc_coherent()返回存儲任何數據的指針。此函數採用dma_addr_t類型的變量,並將其用於DMA操作。所以我想在DMA操作開始之前讀取這個值。

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    我在讀一些網絡驅動程序時,可以通過DMA將數據包直接傳遞到用戶內存中。在這種情況下,內核的TCP/IP堆棧如何處理數據包?

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    我有一塊內存映射到系統地址空間的pcie板。 內存控制器可以接受長時間突發讀取或寫入請求。 在主機程序中,當我使用for循環讀取或寫入內存時,主機是否會自動生成突發性pcie讀取/寫入請求到我的主板? 如果不是,主機將如何發出長時間突發請求? 問候 項超

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    我是open source project that relies on the DMA controller to do PWM on Raspberry Pi IO pins的維護者。這項技術需要使用一個DMA通道。我們在歷史上對DMA通道0進行了硬編碼,但得到了多個錯誤報告,指出X在同一時間運行時程序無法正常工作(錯誤報告:here和here,etc)。 我們在Raspberry PI固件中

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    我想編寫一個函數(changeSize)使用DMA,在那裏我可以選擇改變它的(的數組的大小),無論我想要什麼,其中oldEls是原始大小,newEls是新的大小。如果newEls比oldEls大,我只想補充零點的到最後,如果它比oldEls小,我只想截斷。 「ptr」參數需要指向新的數組。我的理解是這與C realloc()函數類似。 使用下面的代碼,我輸出以下內容:0,0,3,6,0,0,0,0

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    我正在研究Linux環回和IP網絡數據處理,而且似乎沒有代碼可以涵蓋2個不同套接字上的CPU通過環回傳遞數據的情況。 我認爲應該有可能檢測到這種情況,然後應用硬件DMA,以避免NUMA爭用將數據複製到接收器。 我的問題是: 我是正確,這不是目前在Linux中做了什麼? 我認爲這是可能的正確軌道? 我應該研究哪些內核API或現有驅動程序來幫助完成這樣的環回版本?

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    我正在開發Linux DMA驅動程序。用戶空間應用程序希望驅動程序執行異步操作(數據傳輸)並僅在操作完成時才獲得通知。如何異步通知用戶空間應用程序? 我知道在內核空間中,可以安裝中斷處理程序來處理完成中斷。我的問題是用戶空間,因爲我的數據必須在用戶空間中處理。我能想到的是在用戶空間中創建一個線程並等待驅動程序完成任務。有沒有更好的方法來處理這個問題?還是我在錯誤的方向思考? 更一般地說,如何在用戶