systemc

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    需要更快的軟件模塊（虛擬原型）？

    這個問題與軟件建模（虛擬原型）有關。 我不完全理解爲什麼需要更快的虛擬原型。我的意思是與RTL模塊相比，它可以在更短的時間內模擬所需的功能。 我可以理解需要一個週期精確的軟件模塊，但不是一個更快的模塊。 在這個方向的任何光？ 謝謝！
    systemc 2014-04-19

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    錯誤：「sc_unit」沒有在這個範圍內聲明（SystemC的2.3.0）

    // first_counter.cpp SC_MODULE (first_counter) { sc_in_clk clock; // clock input of the design sc_in<bool> reset; // active high, synchronous reset input sc_in<bool> enable; //
    c++ compilation systemc 2014-06-11

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    SystemC和Verilog之間的公共頭文件

    我有一個使用Verilog和C（SystemC來精確）的應用程序。我想知道是否有一種方法可以在整個應用程序中使用通用頭文件？ 這樣的： #define FOO 4 不必須是重複另一個Verilog檔案 `define FOO 4
    header verilog system-verilog systemc 2014-03-05

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    JNI調用在SystemC中不起作用sc_core :: sc_start（）調用

    在SystemC中使用JNI時，我面臨一個非常奇怪的問題，我無法解釋自己。 只是關於我的使用環境的一些信息：我目前正在開發一個安裝了openjdk-6和openjdk-7的12.04 Ubuntu。這個問題重現與兩個jdks！ 有了這個主要的方法： #include "tlm.h" #include "SystemCWrapper.h" int sc_main(int argc, char
    jni systemc 2014-06-13

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    如何在終端的Mac OS X中使用和安裝SystemC？

    如何在終端mac OS X中使用和安裝SystemC？ 我試過邏輯詩人應用程序，但我使用os x 10.10，所以它不起作用。 所以我想知道如何編譯和執行SystemC在終端。 我在終端找不到SystemC的詳細信息。 謝謝
    macos terminal install systemc 2014-09-21

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    SystemC模塊不能用於SC_THREAD

    我試圖在SystemC中描述一個簡單的NAND模塊，但我面臨一些困難。 模塊，通過規範，應該有一個4ns的延遲，所以我試圖用「等待」語句和SC_THREAD與流程來形容它，如下所示： //file: nand.h #include "systemc.h" SC_MODULE(nand2){ sc_in<bool> A, B; sc_out<bool> F; v
    systemc 2014-09-30

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    在VLAB仿真過程中在屏幕上顯示圖像

    我正在腳本下VLAB下的SystemC仿真演示。 如何在屏幕上顯示圖像，作爲演示在其中執行的一項操作？ 我試圖打開一個窗口，並使用wx顯示圖像，但這需要我創建一個wxApp，它阻止了我的演示的線程。 編輯： 這個問題幾乎達經常被問同樣的問題：「我怎樣才能顯示在Python的形象？」，因爲VLAB解釋是Python的。但是，我正在尋找一種解決方案，不需要我將VLAB指向第三方庫。
    python systemc vlab 2014-06-24

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    在C++中傳遞字符串作爲模板參數

    我試圖傳遞一個字符串作爲C++模板參數，但我似乎無法使其工作。爲了記錄，我正在使用SystemC庫（因此所有sc_xxx的東西）。據this answer，我在做什麼應該工作，但我不明白我做錯了什麼。編譯器告訴我， 「filePath不能出現在恆定的」 表情「。任何幫助，將不勝感激。 的main.cpp int sc_main(int argc, char* argv[]) { con
    c++ string templates systemc 2014-10-02

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    GDB：進入庫

    運行我的應用程序我得到一個分段錯誤。我跑了GDB以檢查我的代碼是失敗，但我得到了以下的輸出： Program received signal SIGSEGV, Segmentation fault. 0x39ca8000 in ??() (gdb) bt #0 0x39ca8000 in ??() #1 0xb7d5df9a in sc_core::sc_port_base::comple
    c++ debugging gdb segmentation-fault systemc 2014-01-30

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    如何判斷細化是否在斷點處完成？

    當我在VLAB腳本中創建一個斷點時，如何才能確定是否已經完成了精細化處理？ 我的腳本達到該引發錯誤的陳述：已經完成 Error: (E529) insert module failed: elaboration done 所以很明顯的闡述是意外（對我來說）（該引起這是vlab.instantiate("stim", "stim")命令）。我需要以某種方式回到這個過程中，並找出發生的地方 - 所以我
    systemc vlab 2014-04-01
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