由於我只看到具有2xSCK輸入時鐘的SPI模塊,我想問問是否可以實現具有與SPI模塊相同頻率的SCK模塊。具有與SPI模塊時鐘相同的SCK的SPI模塊 - VHDL
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A
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輸入clock >= 2×SCK
是物理邊界。這就是所謂的奈奎斯特率。
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根據你是SPI主控還是從屬,你可能會想出一些東西,但最好的解決方案是簡單地增加你的時鐘頻率。如果您的硬件支持它們,則可以使用DDR(雙倍數據速率)輸入或輸出寄存器在兩個時鐘沿上註冊輸入或驅動輸出。如果您是從機,您可以將SPI時鐘分配爲時鐘輸入,並使用輸入時鐘沿鎖存數據。然而,你將不得不在你的邏輯內跨越時鐘域。 我強烈建議儘可能增加邏輯時鐘頻率。
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