2012-12-02 26 views
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我正在使用2012a或2011b和System Generator 13.1在simulink中進行協同仿真。當構建要加載到zynq fpga的硬件的庫塊時,我將系統生成器配置爲「硬件Co-Sim」,通過此步驟即可完成所有工作。但是,在simulink/pc仿真結束時,我還沒有找到任何有關如何配置的良好資源。 我是否正確地認爲它應該被設置爲硬件co-sim而不是其他設置(HDL網表)或類似的東西?Xilinx Co Simulation的系統生成器配置

目前,系統似乎正在加載該塊就好了,但jtag庫丟失,不知道這是一個sysgen問題還是軟件版本問題。我的理解是,sysgen在2012a仍處於測試階段。

在此先感謝。

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如果您在賽靈思論壇上發佈該問題,將會得到更快的回答:http://forums.xilinx.com – OutputLogic

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是的,它應該被設置爲一個硬件協同仿真(您的板 - >連接類型)。 開始模擬時會發生電路板配置。 (或者您可以使用Impact手動編程,然後在塊屬性中檢查「跳過配置」)。