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Cocotb在門級仿真中使用泛型/參數

我已經成功地爲我的設計設置了Cocotb驗證環境，並且我很高興它可以用於RTL（在我的情況下爲VHDL）。 我的設計是使用泛型，和我檢索這些仿製藥在Python代碼（大多在RUN_TEST和模型）的幾個地方的值，模板如下： my_generic = dut.GEN_NAME.value 不幸的是，這不適用於門級仿真，因爲我的綜合設計不再具有泛型，因此dut.GEN_NAME.value不存在。 我

python vhdl simulation cocotb netlist 2016-12-07

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從網表中逐行使用perl提取數據

我的問題是關於從Perl中的文件中提取數據。在附件中有網表的標準格式。運行程序後，我得到了元素到一個數組@name_gate，但當我試圖print @name_gate[0]而不是第一個元素時，我得到了整個第一列，類似於第二列@name_gate[1]。 所以問題是我再次得到了一個字符串@name_gate[0]我想訪問元素。 my @ind; my $index=0; my $file =

perl vlsi netlist 2017-03-27

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Vivado錯誤：活躍的網表限制

最近，我一直在堅持從Vivado同樣的錯誤，當我嘗試進行綜合我的設計： [通用17-70]應用程序異常：活躍的網表的數量超出限制（255 ） 有人知道這個「限制」是什麼意思嗎？它是軟件的限制，還是指FPGA的容量？有一些方法可以避免它，或者我必須改變我的所有設計以減少網表？ 在此先感謝您的幫助， 霍爾迪

limit fpga vivado netlist 2017-05-19

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