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我有一個頂級的Verilog模塊，用一些輸出記錄來實例化一個VHDL模塊。我可以從Verilog模塊訪問VHDL記錄輸出嗎？
有沒有從我的Verilog頂部訪問這些記錄的好方法，還是我最好只是打破記錄分開？
A
回答
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你可以（有注意事項）。創建一個與「記錄」類型相同的「結構」。只要您不重新排序連接，這兩個將映射1：1。請注意，如果您的工具實際支持它。
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在Modelsim中嘗試過，無法使其正常工作。我不得不使用VHDL包裝器。 – Russell 2014-08-28 18:05:07
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從我讀過的最好的選擇是圍繞VHDL塊創建一個VHDL包裝，並打破您提到的記錄類型。 – 2012-04-23 09:17:55
啊好想法。我原先的想法是重新定義端口，但簡單的包裝是一個更乾淨，更容易，謝謝！ – JohnFarl 2012-04-23 19:42:33